Analog Synth Forum III
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Anz's SEQ(安西さんのシーケンサー)回路図篇 公生32+ 2015/12/03-17:28 設計と製作/Design&Build [添付]

Re:Anz's SEQ(安西さんのシーケンサー)回路図篇 公生32+ 2015/12/20-10:20 [添付]
Re:Anz's SEQ(安西さんのシーケンサー)回路図篇 g200kg 2015/12/20-19:33
Re:Anz's SEQ(安西さんのシーケンサー)回路図篇 公生32+ 2015/12/20-20:10
Re:Anz's SEQ(安西さんのシーケンサー)回路図篇 公生32+ 2015/12/20-22:37
Re:Anz's SEQ(安西さんのシーケンサー)回路図篇 g200kg 2015/12/20-23:06
Re:Anz's SEQ(安西さんのシーケンサー)回路図篇 公生32+ 2015/12/25-11:06 [添付][添付]

Re:Anz's SEQ(安西さんのシーケ...  公生32+ E-MAIL  - 2015/12/20-10:20 -

一生懸命考えた末に辿り着いた結果が、この回路です。
先に公開したものと大して変わり映えしませんが、74HC123のところの時定数のRをアナログフォトカプラに変更しました。
多分、前回の回路は動きません。
で、今回の回路は、DACも通していなくてマルチプライヤも通していません。
これは一重に私の実力の無さで、どうしても回路が思い浮かばず断念したものです。
そのかわりに前回のものを踏襲しました。
追加はフォトカプラとドライブ用のトランジスタで、後は思い切って削った結果、かなりすっきりした回路になっています。
g200kgさんが問題とされたフルスケールの変化ですが、DACを通していないのでフルスケールが変化することもなく不要じゃないかしら??と思ったのですが、如何でしょうか?(PWMそのものは、デジタルそのものですから)

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Re:Anz's SEQ(安西さんのシーケ...  g200kg E-MAIL  - 2015/12/20-19:33 -

ワンショットの長さがVCOの周波数と連動していませんので、VCOの周波数が変化した時にデューティ比が変わってしまうのではないでしょうか?

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Re:Anz's SEQ(安西さんのシーケ...  公生32+ E-MAIL  - 2015/12/20-20:10 -

うーん、私のミスですね。
申し訳ありません。
仰る通り、周波数に追随したデューティー比にはならないです。
これを活かすなら、これにFVCを付けて、その出力電圧をPWM入力に加算してやれば同じことはできると思いますが・・・。
再度、色々な角度から考え直しますね。

本当に理解が悪くて申し訳ありません。

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Re:Anz's SEQ(安西さんのシーケ...  公生32+ E-MAIL  - 2015/12/20-22:37 -

ひとつだけ、教えていただけませんでしょうか。
CPUのSClk、RClk共にデジタル入力でよろしいでしょうか?
DA変換された後で、コンパレーターに入力され、CPUに出力されているのですが・・・。
そうすると、アナログ入力ということになりませんでしょうか?
そのあたりが引っかかって仕方ありません。
どうぞ、お教えいただけませんでしょうか?

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Re:Anz's SEQ(安西さんのシーケ...  g200kg E-MAIL  - 2015/12/20-23:06 -

公生32+ wrote :
>CPUのSClk、RClk共にデジタル入力でよろしいでしょうか?
>DA変換された後で、コンパレーターに入力され、CPUに出力されているのですが・・・。
>そうすると、アナログ入力ということになりませんでしょうか?
>そのあたりが引っかかって仕方ありません。
はい、デジタル入力のつもりです。コンパレータの出力は矩形波ですので必要ならCPUのロジックレベル(0V/5V)にレベル変換して接続する事になります。

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Re:Anz's SEQ(安西さんのシーケ...  公生32+ E-MAIL  - 2015/12/25-11:06 -

そういうわけで時間がかかりましたが、VCO部の素案2題です。

1題は、FVCを使ったアナログ回路です。
もう1題の方は、DAC以後の掛け算器、コンパレータをアナログで処理したものです。

両方共に細部のバグ取りは行っていません。
特にカウンター周辺の接続が怪しいです。

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